eda第五章复习总结

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1、5.1VHDL概述硬件描述语言（VHDL）的突出优点1.打破了1C设计者与使用者的界线2.VHDL及其配套工具软件简单易学，直观明了，便于迅速掌握，也便于修改。3.极大地缩短了专用芯片的开发周期，降低开发成本，加快了产品更新换代的速度，提高产品的市场竞争力。4.大大缩小电路板面积和整机体积，提高产品可靠性，增强产品功能，实现技术保密。5.可实现电路设计的模块化和积木式多级组合。各模块均可在今后被重复再利用（调用）06.完全实现拥有整机的自主知识产权，不再在关键芯片（专用芯片）的进口及价格方面受制于人。5.2VHDL程序的结构一、基木的VHDL描述的组成：1.实体

2、（entity）部分64页2.结构体（architecture）部分67页IN（输入）、OUT（输出）是表示信号的类别；BIT是表示信号的类型，BIT是系统定义的类型，即二进位类型，信号只有‘0’和‘1，两种值；每个VHDL语句都是以“;”结束，包括最后一个语句也不例外；VHDL中的“注释”是以两个减号开始的。二、实体描述ENTITY实体名ISPORT（信号名：类别信号类型；信号名：类别信号类型）；END实体名；同样类别和类型的信号可以用逗号分隔，在一个语句行中说明。信号的类别主要冇以下4种：IN：此信号是输入信号；OUT：此信号是输出信号，提供给其他的实体；B

3、UFFER：缓冲信号，也是实体的输出信号，但是可以被实体本身的结构体读入；INOUT：双向信号，既可以输入，也可以输出。5.1VHDL概述硬件描述语言（VHDL）的突出优点1.打破了1C设计者与使用者的界线2.VHDL及其配套工具软件简单易学，直观明了，便于迅速掌握，也便于修改。3.极大地缩短了专用芯片的开发周期，降低开发成本，加快了产品更新换代的速度，提高产品的市场竞争力。4.大大缩小电路板面积和整机体积，提高产品可靠性，增强产品功能，实现技术保密。5.可实现电路设计的模块化和积木式多级组合。各模块均可在今后被重复再利用（调用）06.完全实现拥有整机的自主知识

4、产权，不再在关键芯片（专用芯片）的进口及价格方面受制于人。5.2VHDL程序的结构一、基木的VHDL描述的组成：1.实体（entity）部分64页2.结构体（architecture）部分67页IN（输入）、OUT（输出）是表示信号的类别；BIT是表示信号的类型，BIT是系统定义的类型，即二进位类型，信号只有‘0’和‘1，两种值；每个VHDL语句都是以“;”结束，包括最后一个语句也不例外；VHDL中的“注释”是以两个减号开始的。二、实体描述ENTITY实体名ISPORT（信号名：类别信号类型；信号名：类别信号类型）；END实体名；同样类别和类型的信号可以用逗号分

5、隔，在一个语句行中说明。信号的类别主要冇以下4种：IN：此信号是输入信号；OUT：此信号是输出信号，提供给其他的实体；BUFFER：缓冲信号，也是实体的输出信号，但是可以被实体本身的结构体读入；INOUT：双向信号，既可以输入，也可以输出。系统预定义的信号类型有：BIT：二进位型，信号的值只能是‘0’或‘1’。BIT.VECTOR：二进位向量，实际对应的是二进位数组；BOOLEAN：布尔型，取值只能是true或者false;INTEGER：整型，一般都用32位二进制数表示整型数；CHARACTER：字符型，使用8位编码的ASCII字符。三、结构体描述ARCHIT

6、ECTURE结构体名OF实体名IS＜声明部分＞BEGIN＜描述部分＞END结构体名；对于一个实体来说，可以有儿种不同的结构体描述。5.3VHDL程序的元素85页85页91页预定义：♦整数Integer:-（2的31次方-1）—2的31次方-1♦实数Real：-1.0E+38-+1.0E+38♦位Bit:’0’或’1’♦位矢量Bit_Vector:”001100”♦布尔量Boolean：真或假♦字符Character:’A’，’C’♦物理Time:预定义为时间，其他如电压、电流等也为物理型♦错误等级:NOTE、WARNING、ERROR、FAILURE♦自然数（N

7、atural）、正整数（Positive）♦字符串（String），如”morning”用户自定义类型：96页♦枚举型可以通过枚举类型来定义信号的取值。除了最常用的二值逻辑（已经预定义为BIT型），还可以冇三值逻辑（信号冇三种取值：‘0’、‘1’和‘z’），九值逻辑等TYPE枚举类型名IS(枚举型值表)；如TYPEqitJogicIS(•()’，’1’W)♦STD—ULOGIC7±IEEE1164标准逻辑包中所定义的std.ulogic类型是一种九值逻辑，也是一种枚举型的数据类型：TYPEstd一ulogicIS(TT，-Uninitialized•X’，—Fo

8、rcingUnknown