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时间:2019-10-18
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1、第一部分设计任务1.1设计任务设计、制作一个带有校时功能、可定时起闹的数字闹钟。1.2设计指标1.有“吋”、“分”十进制显示,“秒”使用分个位数码管上的DP点显示。2.计时以24小时为周期。(00:00-23:59)3.具有校时电路,可进行分、时较对。4.走吋过程能按预设的定吋吋间(精确到小吋)启动闹钟产生闹铃,闹铃响时约3s。第二部分设计方案(简要)2.1总体设计方案说明整个数字闹钟由LM555构成多谐振荡器,,调整电阻与电容改变频率,使其输出秒脉冲。74LS163、74LS160、74LS48和4只共阴极数码管等构成其数字显示部分,校准部分运用跳线法实现,闹钟采用蜂鸣器、
2、74LS42、74LS138、74LS00和74LS123,达到其整点闹铃的功能。2.2模块结构与方框图数字闹钟分为秒信号发牛器、走时电路、时间校对电路和闹钟电路这几个模块。第三部分电路设计与器件选择(详细)3.1秒信号发生器1.1.1模块电路及参数计算用LM555芯片以及外围电路搭建成一个多谐振荡器,通过设计外围电路的参数输出方波频率为1Hz,以下是其模块电路。经过计算,各参数如下图中所见。2.4kQ220pFl・5kQVcc().01pFRi=1.5KQR2=2.4KQC=220(12Tph=0.7(R1+R2)C=0.7R2Cf十1HzTphPL=0.7(7?!+2R2
3、)C3.1.2工作原理和功能说明LM555吋基电路内部由分压器、比较器、触发器、输出管和放电管等组成,是模拟电路和数字电路的混合体。其中6脚为阀值端(TH),是上比较器的输入。2脚为触发端(TR),是下比较器的输入。3脚为输出端(OUT),有0和1两种状态,它的状态由输入端所加的电平决定。7脚为放电端(DIS),是内部放电管的输岀,它有悬空和接地两种状态,也是由输入端的状态决定。4脚为复位端(R),叫上低电平(<0.3V)吋可使输出端为低电平。5脚为控制电压端(CV),可以用它来改变上下触发电平值。8脚为电源(VCC),1脚为地(GND)。这里我们用来产生秒脉冲信号。3.1.
4、3器件说明(含结构图、管脚图、功能表等)LM555/LM555C系列功能强大、使用灵活、适用范围宽,可用来产生时间延迟和多种脉冲信号,被广泛用于各种电子产品屮。555内部结构图输岀级下图是LM555的管脚图:引脚编号符号功能说明1GND地线2TR触发3OUT输出4RES复位5CV控制电压6TH阀值7DIS放电8VCC电源3.2走时电路设计(时.分.秒)3.2.1模块电路电路由74LS163、74LS160、74LS48和4只共阴极数码管构成r161514131211109码I16151413121110974LS4816151413121110974LS48115141312
5、1110974LS4816151413121110974LS4816151413121110974LS16016151413121110974LS16016151413121110974LS16314131211''、9874LS0014131211"9874LS0014131211“9874LS2016151413121110974LS16316151413121110974LS1633.2.21作原理及功能说明整个电路由74LS163、74LS160和74LS00、74LS20构成模分别为24、60、60的时、分、秒计数器,再通过74LS48译码,共阴极数码管显示,达到走
6、时的目的。秒信号控制“秒”部分的走时,当到达60产生进位吋,信号传给“分”部分,依此类推,当分到达60产生进位时,信号传给“小时”部分,并通过共阴极数码管显示出来。3.2.3器件说明(1)74LS163①结构图QoRCO54/74LS163原理图①管脚图:♦R—1<716"VCC引出端符号:CP-215-TCP0—P1—341413-Q0-01TC进位输出端P2—512-Q2CEP计数控制端P3—611-Q3CEP-710-CCTQ0-Q3输出端GND—89-PECET计数控制端③功能表:PECETCEPActionontheRisingClockEdge(^/^)LXXXR
7、ESET(Clear)HLXXLOAD(Pn—►Qn)HHHHCOUNT(Increment)HHLXNOCHANGE(Hold)HHXLNOCHANGE(Hold)说明:H—高电平L—低电平X—任意(2)74LS160①结构图②管脚图希一1<716"VCC引出端符号:CP—215-TCP0—314-00TC进位输出端P1—413-01P2—512-Q2CEP计数控制端P3—611-Q3CEP—710-CHQ0-Q3输出端GND—89一斥①功能表*SRPECETCEPActionontheRisingC
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