高压SVG用户须知

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时间:2019-09-20

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1、用户须知第一章用户须知1.1接收产品时的注意事项用户在接收高压动态无功补偿装置时,请认真确认:l在运输过程中是否有损坏。l本体铭牌数据是否与您的订货相符。l查阅装箱单,检查随机发送的附件是否齐全。用户初次使用时请先认真阅读本使用手册以保证按照正确的方法使用而避免误操作。如在接收过程中检查发现问题,请速与本公司联系解决。1.2产品的保修用户购买本产品起一年内为产品保修期,在保修期内,我们对产品质量问题24小时内提供满意答复,并可根据情况派遣维护技术人员赶赴现场。但在以下情况下,即使在保修期内,也是有偿服务。(1

2、)使用时操作不当以及不适当的修理、改造引起的故障。(2)超出产品使用范围使用而出现的故障。(3)购买后外力引起的人为损伤,包括运输中的损伤。1.3安全注意事项请用户在使用过程中务必注意人身安全,禁止在不断电的情况下接触装置的内部元件,禁止打开逆变柜,禁止攀爬SVG设备。系统所用参数在施工完毕时均已经调至最优,请勿擅自改动,如有必要,应与本公司及时联系确定后方可进行改动。因操作不当或不按本说明书使用而引起的安全事故本公司将不负任何责任。12——SVG无功补偿系统构成第一章SVG无功补偿系统构成2.1SVG装置构

3、成高压SVG型静态无功发生器由主控制器柜、功率柜、电抗器柜、高压开关柜、高压电容器柜组成。SVG功率柜是系统无功补偿的终端设备,其中SVG为系统提供可调的感性、容性无功。SVG功率柜采用风冷设计,各柜体均在室内安装。单元柜由IGBT等诸多大功率器件组成。主控制器所输出的控制信号转换成光信号传输至各相单元,同时将各单元中信息传输返回的光信号转成5V电信号传输至主控制器,以实现电压隔离,光纤的使用大大增强了系统的安全性。主控制器安装于控制保护屏内,室内安装。主控制器是一6U的标准插件箱,由若干电路板组成,采用高速

4、数字信号处理芯片(DSP)、CPU与CPLD一体的工业SOC芯片,2片6通道10MHz快速16位AD采集芯片,具有运算速度快,控制精度高,抗干扰能力强等优点。主控制器提供液晶显示和触摸屏输入,人机界面人性化设计,操作简单方便,美观大方。主控制器负责监视系统电压电流和SVG运行状态,并根据系统无功实时调整控制IGBT的开关,为SVG设备提供各种保护。主控制器通过基于RS485的通信线路与上位机进行系统信息的传递。同时,主控制器所输出的SVG运行状态的开关信号可接入用户现有的综合保护系统,由综合保护系统来提供鸣笛

5、报警。用户可以通过上位机监控软件直观地对SVG的运行状态进行查看,对相关参数进行设置,对历史数据等进行统计与察看,并且可以根据用户需要,通信系统接入综合保护系统中,便于用户统一管理。高压SVG型静态无功发生器总体结构图见下图2.1。12——SVG无功补偿系统构成进线柜控制柜功率柜C相1~3功率柜B相1~3功率柜A相1~3启动柜图2.1其中电抗器部分放在启动柜中。2.2系统电气结构如前所述,SVG是通过电抗器和母线相连,主控制器通过采样系统电压电流,可以提供2~25次谐波的含量分析,并给出总谐波含量。用户可以从

6、主控液晶和上位机上查看到谐波指标,据此对比滤波前后的效果。图2.2是SVG的电气结构示意图。母线上接了SVG,主控制器根据系统无功功率之和自适应的调整SVG的无功输出。12——SVG无功补偿系统构成图2.22.3SVG整体结构SVG设备从物理结构上分为控制柜、功率柜、启动柜、开关柜等部分。对于不同用户,随SVG设备容量大小以及出厂日期的不同,SVG外观会有所区别,这些区别主要体现在柜体外部风格(颜色、滤网形式)、整体尺寸大小、控制柜正面宽度、风机个数及通风方式、液晶屏形式及安装位置、功率单元的排列方式(横排或

7、竖排)、柜体布置(L型、一字型)等方面,但SVG设备的几个组成部分不会发生根本变化。2.4SVG设备控制柜组成说明SVG设备控制柜主要由控制器、DC24V电源、控制电源开关、接线端子、液晶显示器、操作按钮等部分构成。12——SVG无功补偿系统构成对不同用户,控制柜宽度可能不尽相同(600mm或300mm),显示屏可能装在正面、侧面或功率柜上。控制柜主要部分功能介绍如下:控制器:控制器为SVG设备的核心,它接收和处理来自操作界面的控制命令,产生每相各级功率单元的触发脉冲,同时采集和处理所有功率单元反馈回来的故障

8、信息。10KV装置的主控制器由电源板、I/O板、电压、电流数据采集板、DSP+FPGA主控板、FPGA脉冲分配板、底板构成。以下为10KV装置控制器图。空板FPGC脉冲分配板A相9~12单元FPGC脉冲分配板A相5~8单元FPGC脉冲分配板A相1~4单元FPGB脉冲分配板A相9~12单元FPGB脉冲分配板A相5~8单元FPGA脉冲分配板A相9~12单元FPGB脉冲分配板A相1~4单元FPGA脉冲分配

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