数字电路与逻辑设计.ppt

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1、数字电路与逻辑设计张林行第5章：组合逻辑电路5-1概述5-2组合逻辑电路分析5-3组合逻辑设计5-4竞争与冒险吉林大学仪器科学与电气工程学院：数字电路与逻辑设计基于门电路的设计：以基本逻辑门作为实现的物理载体，集成度较低，体积大，相应的功耗也比较大。随着半导体制作工艺的进步，人们利用逻辑门设计出一些比较常用的逻辑部件（中规模集成电路MSI），这些中规模的逻辑部件除了可以完成预定的基本功能外，还可以通过适当变换连接，构成其他各类功能的逻辑部件或者数字系统，兼顾了通用性，灵活性以及多功能性。5-3-2基于中规模集成电路的组合逻辑设计目前随着半导体工

2、业的飞速发展，中规模集成电路已经逐渐淡出历史舞台，取而代之的是集成度更高，功能更为强大，使用更为灵活的CPLD/FPGA器件或者专用的ASIC器件。但中规模集成电路中采用的一些常用的逻辑功能，对于数字系统的设计和模块划分仍然具有指导借鉴意义。为了兼顾通用性，中规模集成电路的逻辑功能多是根据实际应用中的功能需求为基础而设计出来的，如同高级程序设计语言中的顺序，选择，循环三大类控制语句一样。一、译码器（decoders）二进制译码器二-十进制译码器七段译码器将N个输入变量变换为2N个输出，每个输出对应N个变量的一个最小项或者最大项（取决于电路结构）

3、。二进制译码器N个输入2N个输出一个或多个使能端74x1383-8译码器74x139双2-4译码器译码器的级联七段译码器74LS48功能描述：BI熄灭（输出全0）LT灯测试（输出全1）RBI灭零74LS47共阳数码管驱动ICOC输出74LS49共阴数码管驱动ICOC输出二、编码器（encoders）2N个输入N个输出其他输入输出控制端二进制优先编码器（priorityencoders）74LS1488线-3线优先编码器I0~I7：编码输入A0~A2：编码输出EI：使能输入EO：使能输出GS：编码有效输出功能表二-十进制编码器：74LS147将输

4、入（代表十进制数字）编码为8421BCD码三、多路选择器（multiplexer）2N个数据输入，N个选择信号输入，依据N个选择信号的取值从2N个输入数据中选择一个送到输出端。74x1518选1MUX多路选择器又称数据选择器，多路开关，简写为MUX。74x1574bit2选1MUX*多路分配器（Demultiplexer）又称数据分配器，常用DEMUX表示。其结构与多路选择器正好相反。是一种单输入，多输出的逻辑部件。输入数据从哪一路输出由选择控制输入决定。输出与输入的逻辑关系？与译码器有无相似之处？四、数值比较器（comparator）用于比较

5、两个数的大小。4位比较器构成12位比较器五、二进制并行加法器能够并行产生两个N位二进制数的“算术和”的逻辑部件。*逐位进位二进制加法器rippleadder*超前进位二进制并行加法器根据输入信号同时产生各个进位。74x28374x834bit超前进位二进制全加器基于中规模集成电路的组合逻辑设计方法在熟悉并深刻理解常用中规模逻辑部件功能的基础上，将问题转化为选用逻辑部件的功能。设计时应充分利用逻辑部件的功能以及各个控制端，在门电路的基础上将问题进行进一步的抽象化，类似汇编语言与高级程序设计语言之间的关系（如C）。*设计实例1、用3-8译码器74L

6、S138结合必要的逻辑门实现逻辑函数：画出逻辑连接图。2、有一个8位二进制数，请设计一个电路找出其中第一个0出现的位置。采用8-3优先编码器结合必要的逻辑门设计实现，画出逻辑连接图。3、利用8选1数据选择器74LS151和3-8译码器74LS138设计一个判断两个3位无符号二进制数是否相等的电路。画出逻辑连接图。4、利用4位二进制全加器74LS83设计一个将8421BCD码转换为余3码的代码转换电路。5、利用4位二进制全加器74LS83设计一个8421BCD码全加器。5-4竞争与冒险竞争冒险(hazard)毛刺(glitch)数字电路与逻辑设计

7、：第4章组合逻辑电路竞争与冒险的产生在逻辑电路中，多个输入信号在传输过程中受逻辑门固有延迟、逻辑门级数、导线长度等因素的影响，导致其到达输出端的时间有先有后，这种现象称为竞争现象。更广义的可以将竞争理解为多个信号到达某一点有时差的现象。由于竞争可能导致逻辑电路产生错误的输出，称为冒险。组合逻辑电路中的冒险是一种瞬态现象，表现为输出端出现不应有的尖脉冲（毛刺）。冒险现象的判断1、代数法若某个变量X同时以原变量和反变量的形式出现在函数表达式中，并且在一定条件下该函数表达式可化简为X+X或者XX的形式，则该函数表达式对应的电路在X发生变化时，可能会由

8、于竞争产生冒险现象。2、卡诺图法在卡诺图中，若两个卡诺圈之间存在不被同一个卡诺圈包含的相邻最小项，则该电路可能产生冒险现象。消除冒险现象的方法1、增加